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MT48LC2M32B2P-6:G TR IC DRAM 64MBIT PAR 86TSOP II マイクロンテクノロジー株式会社

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x商品の詳細
記憶タイプ | 揮発 | 記憶フォーマット | ドラム |
---|---|---|---|
テクノロジー | SDRAM | 記憶容量 | 64Mbit |
記憶構成 | 2M × 32 | 記憶インターフェイス | パラレル |
クロック周波数 | 167のMHz | 周期にタイムの単語、ページを書きなさい | 12ns |
アクセス時間 | 5.5 ns | 電圧 - 供給 | 3V~3.6V |
動作温度 | 0°C~70°C (TA) | マウントタイプ | 表面マウント |
パッケージ/ケース | 86-TFSOP (0.400"、10.16mmの幅) | 供給者のデバイスパッケージ | 86-TSOP II |
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Part Number | Description | |
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MT48LC2M32B2P-6:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-7 IT:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-7:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-6:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-7 IT:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-7:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2TG-6:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2TG-7 IT:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-7 IT:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC2M32B2P-55:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-55:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-5:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-5:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6 IT:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6 IT:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-55:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-55:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-5:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-6 IT:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2TG-6 IT:G TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6:G | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-7 IT:G | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-7:G | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2TG-7:G | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2TG-7:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC8M32B2P-6 TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC8M32B2P-7 IT TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC8M32B2P-7 TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC8M32B2TG-6 TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC8M32B2TG-7 IT TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC8M32B2TG-7 TR | IC DRAM 256MBIT PAR 86TSOP II | |
MT48LC4M32B2P-7:G TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-7 IT:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-7:G | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6 IT:G | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A AAT:L | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A XIT:L | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A IT:L TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC2M32B2P-5:J TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A IT:J TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A:J TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A AIT:L TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC2M32B2P-5:J | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A AAT:J | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A AIT:J | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A IT:J | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A:J | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A AIT:L | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A IT:L | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A:L | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A AAT:J TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC2M32B2P-6A AIT:J TR | IC DRAM 64MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A:L TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A AAT:L TR | IC DRAM 128MBIT PAR 86TSOP II | |
MT48LC4M32B2P-6A XIT:L TR | IC DRAM 128MBIT PAR 86TSOP II |
製品の説明
製品詳細
一般的な説明
64MbのSDRAMは高速 CMOSで,動的ランダムアクセスメモリで,67MBのSDRAMを搭載しています.108,864ビット.内部は同期インターフェース (すべての信号はクロック信号の正端,CLKに登録される) を備えた四つの銀行DRAMとして構成されています.7772億480行×256列×32ビットに分けています.SDRAMへの読み書きアクセスはバースト指向で,アクセスは選択した位置から始まり,プログラムされた順序でプログラムされた数々の位置で継続する.アクセスは ACTIVE コマンドの登録から始まります,その後 READ または WRITE コマンドが続く. ACTIVE コマンドと一致して登録されたアドレスビットは,アクセスされる銀行と行を選択するために使用されます (BA0,BA1,A0-A10 行を選択). READ または WRITE コマンドと一致して登録されたアドレスビットは,バーストアクセスのための開始列位置を選択するために使用されます.
特徴
• PC100 機能• 完全同期; すべての信号はシステムクロックの正端に記録されます
• 内部パイプライン操作; コラムの住所は毎週クロックサイクルで変更できます
• 隠し列へのアクセス/予備充電のための内部バンク
・ プログラム できる 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音 音
• 自動 プレチャージ,コンカラント 自動 プレチャージ,自動 更新 モード を 含む
• 自動 更新 モード
• 64ms 4,096サイクルリフレッシュ (15.6μs/row)
LVTTL対応の入力と出力
単一の +3.3V ±0.3V 電源
• 1, 2, 3 の CAS レイテンシー を サポート する
仕様
属性 | 属性値 |
---|---|
製造者 | マイクロン・テクノロジー株式会社 |
製品カテゴリー | メモリIC |
シリーズ | - |
パッケージ | |
パッケージケース | 86-TFSOP (0.400", 10.16mm 幅) |
動作温度 | 0°C~70°C (TA) |
インターフェース | パラレル |
電圧供給 | 3V~3.6V |
供給者 デバイス パッケージ | 86-TSOPII |
記憶容量 | 64M (2M x 32) |
メモリタイプ | SDRAM |
スピード | 167MHz |
フォーマットメモリ | RAM |
記述
SDRAMメモリIC 64Mb (2M x 32) パラレル167MHz 5.5ns 86-TSOP II
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